ACE-Lite I/O coherency分析

• ACE读，I/O设备写
• ACE写，I/O设备读

为了减轻flush cache带来的开销，arm引入了CCI这个硬件模块，通过ACE协议来保证数据的一致性。

ACE-Lite I/O Coherency分析

整体的框架如图所示，ACE-Lite口实现了ACE协议的子集，包含三个部分：

1. Non-shared
2. Non-cached
3. Cache Maintenance

情景分析：

假设现在ACE口上有ARM core，ACE Lite一路有USB，分两种情况，ACE读和ACE写

ACE读，I/O设备写

现在usb cacaheable写了一笔数据进ddr，然后cpu读了一次，这个时候cache中有对应数据的缓存。然后usb又通过dma往同样的地址写了一笔数据，这个时候ACE-Lite 发送MakeInvalid transaction告诉ACE说这笔缓存的数据需要invalidate，这样下次cpu读同样地址数据的时候就从ddr去读了，这样就保证了读数据的一致性。

ACE写，I/O设备读

CPU写一笔setup包，数据进入dcache，然后usb读对应的虚拟地址发送请求，这个时候ACE-Lite发起ReadOnce transaction，发现cache中有数据，那么直接从cache中把数据snoop过来；如果cache是dirty的，那么ACE还会把数据写入ddr（clean cache）。